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一種Windows2000下連續(xù)輸出數(shù)據(jù)的PCI卡
摘要：介紹PCF1536的設(shè)計原理和硬件結(jié)構(gòu)；詳細(xì)討論了大容量FIFO的結(jié)構(gòu)及用CPLD實現(xiàn)FIFO控制器；計算PCF1536工作于Windows2000操作系統(tǒng)下允許的最大中斷延遲jb后將PCF1536應(yīng)用于多路D/A轉(zhuǎn)換器，指出Windows2000的中斷延遲遠(yuǎn)遠(yuǎn)小于41.2毫秒。在視頻輸出、聲吶仿真等實際應(yīng)用中，經(jīng)常要求計算機(jī)能根據(jù)要求穩(wěn)定輸出連續(xù)數(shù)據(jù)流。然而，當(dāng)計算機(jī)工作于Windows2000操作系統(tǒng)下時，由于該操作系統(tǒng)是一個多任務(wù)的非實時操作系統(tǒng)，當(dāng)它收到外部設(shè)備發(fā)來的中斷時，需要延遲一定時間間隔后，才開始執(zhí)行中斷服務(wù)程序。這樣，從計算機(jī)I／O口直接輸出的數(shù)據(jù)流只能是間歇的數(shù)據(jù)流，無法提供連續(xù)數(shù)據(jù)流，不能滿足實際應(yīng)用的需要。
幸運的是，許多實際應(yīng)用只需要低速的連續(xù)數(shù)據(jù)流�？梢岳肞CI總線的高速數(shù)據(jù)傳輸特性，在PCI接口后加入一個大容量FIFO存儲器，高速的PCI數(shù)據(jù)流從FIFO存儲器的輸入端輸入，在FIFO的輸出端就能獲得低速的連續(xù)數(shù)據(jù)流。這樣屏蔽了Windows2000的非實時性，成功滿足實際應(yīng)用的需要。在圖1所示的具體應(yīng)用中，計算機(jī)與PCI卡之間通過PCI總線形成峰值速率達(dá)132MB／s的間歇數(shù)據(jù)流；PCI卡通過局部總線與大容量存儲器之間同樣是峰值速率達(dá)132MB／s的間歇數(shù)據(jù)流；最后通過多路D／A轉(zhuǎn)換電路獲得了速率為16MB／s的連續(xù)數(shù)據(jù)流。
圖1和圖2
為了便于應(yīng)用，將PCI接口模塊與大容量存儲器結(jié)合，設(shè)計了一塊能在Windows2000下以16MB／s的速率連續(xù)輸出數(shù)據(jù)的PCI卡PCFl536。
1 PCFl536的工作原理
PCI卡PCFl536是一個帶有1536KB FIFO的通用PCI卡；在Windows2000操作系統(tǒng)下，它能以16MB／s的速度連續(xù)輸出數(shù)據(jù)。圖2是PCFl536的結(jié)構(gòu)框圖，整個PCFl536包括PCI接口、大容量FIFO存儲器和驅(qū)動器三個模塊。
1．1 PCI接口模塊
PCI接口模塊由PCI9052和配置EEPROM 93LC46組成。PCI9052是PLX技術(shù)公司的產(chǎn)品，兼容于PCI協(xié)議 (2．1版)；它可作為PCI總線的從設(shè)備，支持32位數(shù)據(jù)；突發(fā)傳輸。圖3是PCI9052與PCI金手指和存儲器模塊的連接示意圖。
PCI9052與存儲器有三種連接方式：數(shù)據(jù)地址復(fù)用、奴據(jù)地址非復(fù)用和ISA方式。在PCFl536中，PCI9052架用數(shù)據(jù)地址非復(fù)用方式連接FIFO存儲器。其時序參見文獻(xiàn)[1]。PCI9052與FIFO的連接信號中，ADS表示一次突發(fā)傳輸?shù)拈_始，BLAST表示一次突發(fā)傳輸?shù)慕Y(jié)束，LAD[0：31]為32位數(shù)據(jù)，LBE[0：3]為字節(jié)有效信號。緩存后的時鐘輸出信號BCLKO經(jīng)74LS00送回PCI9052，同時也送到FIFO。FIFO半滿時發(fā)出的中斷信號通過LINTl1進(jìn)入PCI9052，再通過INTA發(fā)送給CPU。由于FIFO的寫入不需要地址，因此PCI9052與FIFO之間沒有地址連接。
1．2 存儲器模塊
1．2．1 存儲器組織
圖4
存儲器模塊由CPLD器件EPM7128SQCl00和四片F(xiàn)IFO器件AL422B組成。AL422B是AVERLOGIC公司的產(chǎn)品，每片AL422B包含384Kx8位DRAM，主要應(yīng)用于視頻輸出。在現(xiàn)有的FIFO存儲器中，AL422B具有最低的價格／存儲位比。這是PCFl536選擇使用AIA22B的主要原因。AL422B的結(jié)構(gòu)框圖如圖4所示。它能完成初始化、復(fù)位、寫和讀等四種操作。初始化操作發(fā)生在上電后0．1ms內(nèi)，WRST和RRST保持為低電子，然后可以開始正常操作。復(fù)位操作中，WRST有效，則輸入數(shù)據(jù)地址設(shè)置為0且清空輸入緩存；RRST有效，則數(shù)據(jù)輸出地址設(shè)置為0且將數(shù)據(jù)預(yù)取到輸出緩存。當(dāng)WE有效時，完成寫操作，在WCK上升沿將D17～D10寫入寫數(shù)據(jù)寄存器；WE無效時，禁止寫操作，寫地址計數(shù)器保持不變。
四片AL422B通過位擴(kuò)展成384K×32位的FIFO存儲器，如圖5所示。
1．2．2 存儲器控制器
AIA22B雖然有不同的數(shù)據(jù)輸入和輸出端口，但與通用FIFO存儲器不同，它并不提供半滿信號、數(shù)據(jù)有效信號等。因此AL422B不是完全意義上的FIFO存儲器。在PCFl536上，使用一片可編程邏輯設(shè)備EPM7128作為FIFO控制器，全面控制AL422B的功能。從圖2和圖5可以看出，EPM7128為FIFO提供RCK、RRST、RE、D1[0：31]、OE、WE、TST、WRST和WCK等讀寫控制信號；當(dāng)FIFO半滿時提供半滿信號HF；另外EPM7128為外設(shè)提供正負(fù)數(shù)據(jù)有效信號、4MHz和8MHz的時鐘佰弓毒世外設(shè)靈活使用。圖6是用VHDL語言對EPM7128編程而成的FIFO控制器。該控制器由JTAG模塊、寫模塊、讀模塊和控制模塊組成。計算機(jī)通過JTAG接口對EPM7128現(xiàn)場編程。當(dāng)PCI9052的數(shù)據(jù)準(zhǔn)備好后，寫模塊按LCLK時鐘將數(shù)據(jù)讀入，接著按WCK時鐘將數(shù)據(jù)寫入AL422B。在FIFO控制器的控制下，整個384K×32位的FIFO存儲器被分為A、B兩部分。當(dāng)數(shù)據(jù)從A部分讀出時，PCI9052將數(shù)據(jù)寫入B部分；反之， 當(dāng)數(shù)據(jù)從B部分讀出時，PCI9052將數(shù)據(jù)寫入A部分。數(shù)據(jù)讀出的速率為16MB／s。當(dāng)A(或B)部分?jǐn)?shù)據(jù)讀完后，F(xiàn)IFO控制器接著從B(或A)部分讀數(shù)，并通過中斷通知CPU向A(或B)部分寫入數(shù)據(jù)。如此循環(huán)往復(fù)。
圖5
1．2．3 最大允許中斷延遲
要保證PCFl536輸出連續(xù)數(shù)據(jù)，就必須保證FIFO不會被讀空。FIFO輸出數(shù)據(jù)的同時，PC機(jī)必須及時補(bǔ)充數(shù)據(jù)。從上可知，整個FIFO存
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