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數(shù)字電路實(shí)訓(xùn)心得體會
當(dāng)我們有一些感想時(shí)，往往會寫一篇心得體會，這樣我們可以養(yǎng)成良好的總結(jié)方法。是不是無從下筆、沒有頭緒？以下是小編為大家整理的數(shù)字電路實(shí)訓(xùn)心得體會，希望能夠幫助到大家。
數(shù)字電路實(shí)訓(xùn)心得體會1
電路實(shí)訓(xùn)，作為一門實(shí)實(shí)在在的實(shí)訓(xùn)學(xué)科，是電路知識的基礎(chǔ)和依據(jù)。它可以幫助我們進(jìn)一步理解鞏固電路學(xué)的知識，激發(fā)我們對電路的學(xué)習(xí)興趣。在大二上學(xué)期將要結(jié)束之際，我們進(jìn)行了一系列的電路實(shí)訓(xùn)，從簡單基爾霍夫定律的驗(yàn)證到示波器的使用，再到一階電路—————，一共五個(gè)實(shí)訓(xùn)，通過這五個(gè)實(shí)訓(xùn)，我對電路實(shí)訓(xùn)有了更深刻的了解，體會到了電路的神奇與奧妙。不過說實(shí)話在做這次試驗(yàn)之前，我以為不會難做，就像以前做的實(shí)訓(xùn)一樣，操作應(yīng)該不會很難，做完實(shí)訓(xùn)之后兩下子就將實(shí)訓(xùn)報(bào)告寫完，直到做完這次電路實(shí)訓(xùn)時(shí)，我才知道其實(shí)并不容易做。它真的不像我想象中的那么簡單，天真的以為自己把平時(shí)的理論課學(xué)好就可以很順利的完成實(shí)訓(xùn)，事實(shí)證明我錯(cuò)了，當(dāng)我走上試驗(yàn)臺，我意識到要想以優(yōu)秀的成績完成此次所有的實(shí)訓(xùn)，難度很大，但我知道這個(gè)難度是與學(xué)到的知識成正比的，因此我想說，雖然我在實(shí)訓(xùn)的過程中遇到了不少困難，但最后的成績還是不錯(cuò)的，因?yàn)槲耶吘乖谶@次實(shí)訓(xùn)中學(xué)到了許多在課堂上學(xué)不到的東西，終究使我在這次實(shí)訓(xùn)中受益匪淺。
下面我想談?wù)勎以谒龅膶?shí)訓(xùn)中的心得體會：
在基爾霍夫定律和疊加定理的驗(yàn)證實(shí)訓(xùn)中，進(jìn)一步學(xué)習(xí)了基爾霍夫定律和疊加定理的應(yīng)用，根據(jù)所畫原理圖，連接好實(shí)際電路，測量出實(shí)訓(xùn)數(shù)據(jù)，經(jīng)計(jì)算實(shí)訓(xùn)結(jié)果均在誤差范圍內(nèi)，說明該實(shí)訓(xùn)做的成功。我認(rèn)為這兩個(gè)實(shí)訓(xùn)的實(shí)訓(xùn)原理還是比較簡單的，但實(shí)際操作起來并不是很簡單，至少我覺得那些行行色色的導(dǎo)線就足以把你繞花眼，所以我想說這個(gè)實(shí)訓(xùn)不僅僅是對你所學(xué)知識掌握情況的考察，更是對你的耐心和眼力的一種考驗(yàn)。
在戴維南定理的`驗(yàn)證實(shí)訓(xùn)中，了解到對于任何一個(gè)線性有源網(wǎng)絡(luò)，總可以用一個(gè)電壓源與一個(gè)電阻的串聯(lián)來等效代替此電壓源的電動勢Us等于這個(gè)有源二端網(wǎng)絡(luò)的開路電壓Uoc，其等效內(nèi)阻Ro等于該網(wǎng)絡(luò)中所有獨(dú)立源均置零時(shí)的等效電阻。這就是戴維南定理的具體說明，我認(rèn)為其實(shí)質(zhì)也就是在闡述一個(gè)等效的概念，我想無論你是學(xué)習(xí)理論知識還是進(jìn)行實(shí)際操作，只要抓住這個(gè)中心，我想可能你所遇到的續(xù)都問題就可以迎刃而解。不過在做這個(gè)實(shí)訓(xùn)，我想我們應(yīng)該注意一下萬用表的使用，盡管它的操作很簡單，但如果你馬虎大意也是完全有可能出錯(cuò)的，是你整個(gè)的實(shí)訓(xùn)前功盡棄！
在接下來的常用電子儀器使用實(shí)訓(xùn)中，我們選擇了對示波器的使用，我們通過了解示波器的原理，初步學(xué)會了示波器的使用方法。在試驗(yàn)中我們觀察到了在不同頻率、不同振幅下的各種波形，并且通過毫伏表得出了在不同情況下毫伏表的讀數(shù)。
總的來說，通過此次電路實(shí)訓(xùn)，我的收獲真的是蠻大的，不只是學(xué)會了一些一起的使用，如毫伏表，示波器等等，更重要的是在此次實(shí)訓(xùn)過程中，更好的培養(yǎng)了我們的具體實(shí)訓(xùn)的能力。又因?yàn)樵谠趯?shí)訓(xùn)過程中有許多實(shí)訓(xùn)現(xiàn)象，需要我們仔細(xì)的觀察，并且分析現(xiàn)象的原因。特別有時(shí)當(dāng)實(shí)訓(xùn)現(xiàn)象與我們預(yù)計(jì)的結(jié)果不相符時(shí)，就更加的需要我們仔細(xì)的思考和分析了，并且進(jìn)行適當(dāng)?shù)恼{(diào)節(jié)。因此電路實(shí)訓(xùn)可以培養(yǎng)我們的觀察能力、動手操做能力和獨(dú)立思考能力。
數(shù)字電路實(shí)訓(xùn)心得體會2
數(shù)字電路又可稱為邏輯電路，通過與（&），或（>=1），非（o），異或（=1），同或（=）等門電路來實(shí)現(xiàn)邏輯。
邏輯電路又可分為組合邏輯電路和時(shí)序邏輯電路。組合邏輯電路是指在某一時(shí)刻的輸出狀態(tài)僅僅取決于在該時(shí)刻的輸入狀態(tài)，而與電路過去的狀態(tài)無關(guān)。
TTL和CMOS電路：TTL是晶體管輸入晶體管輸出邏輯的縮寫，它用的電源為5V。CMOS電路是由PMOS管和NMOS管（源極一般接地）組合而成，電源電壓范圍較廣，從1。2V—18V都可以。
CMOS的推挽輸出：輸出高電平時(shí)N管截止，P管導(dǎo)通；輸出低電平時(shí)N管導(dǎo)通，P管截止。輸出電阻小，因此驅(qū)動能力強(qiáng)。
CMOS門的漏極開路式：去掉P管，輸出端可以直接接在一起實(shí)現(xiàn)線與功能。如果用CMOS管直接接在一起，那么當(dāng)一個(gè)輸出高電平，一個(gè)輸出低電平時(shí)，P管和N管同時(shí)導(dǎo)通，電流很大，可能燒毀管子。單一的管子導(dǎo)通，只是溝道的導(dǎo)通，電流小，如果兩個(gè)管子都導(dǎo)通，則形成電流回路，電流大。
輸入輸出高阻：在P1和N1管的漏極再加一個(gè)P2管和N2管，，當(dāng)要配置成高阻時(shí)，使得P2和N2管都不導(dǎo)通，從而實(shí)現(xiàn)高阻狀態(tài)。
靜態(tài)電流：輸入無狀態(tài)反轉(zhuǎn)（高低電平變換）情況下的電流。
動態(tài)電流：電路在邏輯狀態(tài)切換過程中產(chǎn)生的功耗，包括瞬間導(dǎo)通功耗和負(fù)載電容充放電功耗兩部分。門電路的`上升邊沿和下降邊沿是不可避免的，因此在輸入電壓由高到低或由低變高的過程中到達(dá)Vt附近時(shí)，兩管同時(shí)導(dǎo)通產(chǎn)生尖峰電流。該損耗取決于輸入波形的好壞（CMOS工藝），電源電壓的大小和輸入信號的重復(fù)頻率。電路的負(fù)載電容的充放電也是很大的一部分。
ESD保護(hù)：Electro—Staticdischarge， 靜電放電。
輸入輸出緩沖器：是緩沖器，不是緩存器，就是一個(gè)CMOS門電路。輸入緩沖器的作用主要是1，TTL/CMOS電平轉(zhuǎn)換接口；2，過濾外部輸入信號噪聲。輸出緩沖器的作用是增加驅(qū)動能力。
配成輸入模式不一定比輸出模式更省電：輸入模式時(shí)輸入緩沖器會打開，而輸出模式時(shí)輸出緩沖器會打開。
TESEO上GPIO數(shù)據(jù)寄存器讀寫的注意點(diǎn)：
配置成普通GPIO時(shí)，如果配置成輸出口，那么寫數(shù)據(jù)寄存器會直接輸出該電平，讀數(shù)據(jù)寄存器實(shí)際就是讀鎖存器中最后一次被寫入的值。如果被配置成輸入口，并且上下拉使能的話，那么寫數(shù)據(jù)寄存器就是配置上下拉電阻，而讀數(shù)據(jù)寄存器就是讀輸入引腳的緩沖器，返回的是該引腳的當(dāng)前電平狀況。有些平臺會有專門的狀態(tài)寄存器，無論當(dāng)前引腳被配置成輸入還是輸出，讀該專門的狀態(tài)寄存器都返回該引腳的當(dāng)前電平狀況。
引腳的BOOT state是指在上電重啟或硬重啟時(shí)引腳的狀態(tài)，reset release之后的狀態(tài)為reset state，reset state和state有可能不一樣。TESEO的UART0_TX為boot1，該引腳的信號在上電重啟或硬重啟時(shí)會被鎖存，以備reset release時(shí)給default register map用。
IO的電源電壓配置：IO引腳歸屬于不同IOring，不同的IO ring可以被輸入不同的電壓。CPU在判決IO的邏輯電平時(shí)會和IO ring的電平（乘以高低電平的系數(shù)）作比較。
數(shù)字電路中的擺幅：輸入擺幅和輸出擺幅。輸入擺幅指的是最低輸入高電平和最高輸入低電平的差值，輸出擺幅指的是最低輸出高電平和最高輸出低電平之間的差值，TTL的擺幅偏小。
在時(shí)序邏輯電路里，如果輸入的時(shí)鐘停止，那么整個(gè)電路的功耗很低，原因是時(shí)序邏輯電路里的很多小單元的輸出是由時(shí)鐘驅(qū)動的，時(shí)鐘停止，基本就是高阻態(tài)。如果將整個(gè)模塊的電斷了，那么就會更加省電。
串口通信電路，如果將其關(guān)掉，一般RX線上會是低電平，如果檢測到高電平，就會產(chǎn)生中斷，這個(gè)時(shí)候就可以重啟開啟串口，但是第一個(gè)字節(jié)由于不在串口寄存器里面，因此，數(shù)據(jù)會丟失。
數(shù)字電路實(shí)訓(xùn)心得體會3
這次實(shí)驗(yàn)是本學(xué)期第一次數(shù)電實(shí)驗(yàn)，本以為電路圖，原理功能都已經(jīng)給了，只要按步驟來就會很容易的焊出要求的電路板，于是買好了器件，畫好了原理圖，就開始一個(gè)人開工了，但由于沒有焊電路板和布線的豐富經(jīng)驗(yàn)，訓(xùn)練也不足，雖然自己一個(gè)人很受打擊的焊完第一塊，但是最后什么結(jié)果都沒有，查了一遍電路，也許是因?yàn)樽约号脑蛞舱也怀雒≡谀�，真的是非常痛苦非常折磨啊，于是干脆心一狠，這次和同組的毛同學(xué)一起焊，吸取了上次的教訓(xùn)，不能再閉門造車，這次要取百家之長，于是我先去實(shí)驗(yàn)室看了一下已經(jīng)弄好的同學(xué)的電路板，看他們的布線和版面布局，然后又問了老師很多在第一塊失敗的電路板出現(xiàn)的問題。經(jīng)過老師解答我知道了一般布線是在電路板正面只有布不下的時(shí)候才會在背面布線，而我上次就全在背面布線，到時(shí)整個(gè)電路線路十分混亂也不易于檢查，于是這個(gè)決定在正面布線，然后我們倆畫好了實(shí)物鏈路連接圖，一切就緒，就差開始動工了！
由于第一次的失敗，很受打擊所以這次電線的`連接和焊接就交給了比我細(xì)心的毛同學(xué)來完成，我則負(fù)責(zé)對電路的時(shí)時(shí)檢查和改進(jìn)意見，最后經(jīng)過兩天的緊張焊接（加起來5，6個(gè)小時(shí)）終于完成了，但這次發(fā)現(xiàn)開關(guān)應(yīng)有的作用沒有起到，于是我們開始檢測，發(fā)現(xiàn)跳過開關(guān)環(huán)節(jié)可以出現(xiàn)結(jié)果，于是確定毛病出現(xiàn)在開關(guān)上，我們用萬用表檢查了開關(guān)功能，果然是引腳電路有問題，于是我們進(jìn)行了開關(guān)的功能測試，最后將16個(gè)開關(guān)全部拆下來，又按招正確的單刀雙置介入電路板，終于這個(gè)問題解決了！
這是又測試發(fā)現(xiàn)10，11數(shù)碼沒有實(shí)現(xiàn)加6功能，經(jīng)過邏輯分析發(fā)現(xiàn)問題出在芯片74LS00上于是我們對電線連接做了全面檢查，沒有問題，我懷疑是芯片問題，于是拆下芯片一看，果然在將芯片插入底座是有一個(gè)芯片管腳懸空導(dǎo)致一直是高電平輸出，于是重新插入，終于第一塊板子大功造成！
真是心情愉悅啊。
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