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EDA技術(shù)在電子設(shè)計中的應(yīng)用與特點
21 世紀是信息的時代，各種電子技術(shù)都迅雷不及掩耳的速度更新發(fā)展，電腦、手機、DV 等已成為當代生活不可缺少的一部分，這些電子產(chǎn)品的功能日漸增多，性能越來越好，價格卻有減無增，探究其原因，集成電路制造技術(shù)的發(fā)展和電子設(shè)計技術(shù)的提高是兩大主流因素，集成電路制造技術(shù)以微細加工為主，電子設(shè)計技術(shù)以EDA 技術(shù)為核心。EDA 技術(shù)已成為當今電子技術(shù)發(fā)展的前沿之一，這是在各技術(shù)較先進的國家的共同努力下取得的成果，CPLD、FPGA 可編程邏輯器件的應(yīng)用，無疑為電子設(shè)計帶來了極大的靈活性和適用性。
1 EDA 技術(shù)的概念與特征
1.1 概念
EDA 技術(shù)即是電子設(shè)計自動化技術(shù)，它由PLD 技術(shù)發(fā)展而來，可編程邏輯器件PLD 的應(yīng)用與集成規(guī)模的擴大為數(shù)字系統(tǒng)的設(shè)計帶來了極大的方便和靈活性，變革了傳統(tǒng)的數(shù)字系統(tǒng)設(shè)計理念、過程、方法。通過對PLD 技術(shù)不斷地改進提高，EDA 技術(shù)應(yīng)運而生。
EDA 技術(shù)就是基于大規(guī)�？删幊唐骷模杂嬎銠C為工具，根據(jù)硬件描述語言HDL 完成表達，實現(xiàn)對邏輯的編譯化簡、分割、布局、優(yōu)化等目標的一門新技術(shù)，借助EDA 技術(shù)，操作者可以通過利用軟件來實現(xiàn)對硬件功能的一個描述，之后利用FPGA/CPLD 才可得到最終設(shè)計結(jié)果。
1.2 特征
1.2.1 全新的設(shè)計方法：自頂向下
傳統(tǒng)的電子設(shè)計方法一般多是“自底向上”的，通俗來說就是在確定標準的通用的集成電路芯片之后，再行模塊設(shè)計，最終完成系統(tǒng)設(shè)計。這種設(shè)計長期以來存在著難以克服的缺陷，效率不高，容易出故障，所需元器件太多，消耗大……EDA 技術(shù)是對傳統(tǒng)電子設(shè)計方法的一種突破與變革，它的設(shè)計是“自頂向下”的，也即以系統(tǒng)設(shè)計為切入點，在設(shè)計之時就做好功能方框圖的劃分并完成各部分結(jié)構(gòu)的規(guī)劃，在方框圖劃分階段完成仿真、糾錯工作，同時借助HDL 完成對高層次系統(tǒng)的邏輯描述，經(jīng)驗證后，借助綜合的優(yōu)化工具完成電子設(shè)計，借助EDA 技術(shù)，操作者可以通過利用軟件來實現(xiàn)對硬件功能的一個描述，之后利用FPGA/CPLD 才可得到最終設(shè)計結(jié)果。
這樣，我們可以發(fā)現(xiàn)，不論是仿真還是調(diào)試都是在初期在一個高層次上就完成了的，如此，既有助于及時發(fā)現(xiàn)結(jié)構(gòu)設(shè)計上可能出現(xiàn)的錯誤，減少設(shè)計工作中的失誤，同時有效地提高了電子設(shè)計工作效率和成功率。
1.3 獨特的描述語言：硬件描述語言
EDA 技術(shù)以硬件描述語言HDL 為系統(tǒng)邏輯描述的主要表達方式，那么什么是硬件描述語言?它是相對于一般的計算機語言如C、Pascsl 來說的，多應(yīng)用于設(shè)計硬件電子系統(tǒng)，也屬計算機語言，它描述電子系統(tǒng)的邏輯功能、電路功能和連接方式。ABEL-HDL 和VHDL 是現(xiàn)今應(yīng)用比較廣泛的兩種硬件描述語言，后者較前者應(yīng)用更多。
ABEL 可以支持各種方式的輸入，所謂的輸入方式就是指電路系統(tǒng)設(shè)計的表達方式，包括真值表、狀態(tài)圖。它的描述具有很強的獨立性，與此同時，從寬口徑到系統(tǒng)它都能完成描述，因而可以適應(yīng)不同規(guī)模的編程設(shè)計，利用標準格式設(shè)計還 可以轉(zhuǎn)換設(shè)計環(huán)境，對比VHDL 來說，它的適用面要寬許多，使用操作靈活簡單，要求也要寬松，易于速成。
1.4 典型的設(shè)計：ASIC
現(xiàn)在電子產(chǎn)品更新極快，復(fù)雜度也在不斷提高，有時候一個看起來比較簡單電子系統(tǒng)它的組成也許是數(shù)萬的中小規(guī)模集成電路，這樣就使電子系統(tǒng)經(jīng)常遭遇耗能高、可靠性低等問題的挑戰(zhàn)。ASIC 芯片是對此問題進行改善的一個有效途徑。
它包涵了FPGA 和CPLD 器件，F(xiàn)PGA/CPLD 是實現(xiàn)EDA 的基礎(chǔ)，也是EDA 思想的最終表述手段，屬于高密度的可編程邏輯器件，一般像樣品的研制或者是批量不大的產(chǎn)品開發(fā)它們都能適用，并且極大的縮短設(shè)計周期，削減開銷，避免風險，使產(chǎn)品能夠盡快上市。
FPGA 和CPLD 的結(jié)構(gòu)有所不同，前者是標準的門陣列，而后者是與或陣列，但是二者的集成度及易用性都頗為相似，因而可以并駕齊驅(qū)。當然二者也有各自的特點，其差異表現(xiàn)在以下幾個方面：
(1)顆粒粗細不同。與CPLD 相比，F(xiàn)PGA 的顆粒相對細一些，它的一個顆粒只是邏輯宏單元，而CPLD 的則是邏輯宏塊。
(2)適用結(jié)構(gòu)不同。FPGA 更適合應(yīng)用于觸發(fā)器相對豐富的結(jié)構(gòu)之中，CPLD 比較適合應(yīng)用于觸發(fā)器有限但是積項特別豐富的結(jié)構(gòu)之中。
(3)編程方式不同。FPGA 在邏輯門下就可以實現(xiàn)編程，多采用改變內(nèi)部布線的方式，具備很強的靈活性。GPLD 只有在邏輯快下才可實現(xiàn)變成，多采用修改已經(jīng)固定了的內(nèi)連電路的邏輯功能的方式，速度更快。
(4)功能消耗不同。FPGA 消耗小，CPLD 消耗比較而言大一些。
2 EDA 技術(shù)在電子設(shè)計中的應(yīng)用
EDA 技術(shù)屬于一種層次比較高的電子設(shè)計方式，也可以稱作系統(tǒng)級設(shè)計方法，它以概念來驅(qū)動，電子設(shè)計工作者并不需要利用門級原理圖，只是針對確定了的設(shè)計目標就可以實現(xiàn)對電路的描述，這樣一來，就少了電路細節(jié)的約束和限制，使設(shè)計可以更多的放開從而更具創(chuàng)造性，待設(shè)計人員有了概念構(gòu)思之后，再講高層次描述輸入到計算機中去，EDA 系統(tǒng)在規(guī)則驅(qū)動下就會自動完成整個電子的設(shè)計。
3 基于EDA 技術(shù)的電子設(shè)計應(yīng)注意的事項
第一，考慮到電子電路延時的時間具備不確定性，和部分自動編譯可能會為冗余的電路所簡化兩個因素，將EDA 技術(shù)應(yīng)用于電子設(shè)計中時，不宜采用偶數(shù)個數(shù)的反向器，并以并聯(lián)的方式將它們連接以構(gòu)成“延時電路”;第二，輸入引腳不能置于懸空狀態(tài)，一者要有有源信號來驅(qū)動，再者一些不用的引腳必須時刻保持接地;第三，要切實保證各大器件的電源和地線引腳是始終連接著的，且它們之間有必要進行濾波及去耦;第四，為了使設(shè)計擴展及修改更容易更方便進行，在使用器件的過程中，不管是邏輯單元還是引腳都要有一個多余的量;第五，環(huán)境問題也應(yīng)警惕，盡可能避免器件過熱。
總之，EDA 技術(shù)是對傳統(tǒng)電子設(shè)計技術(shù)的一種突破與創(chuàng)新，如果失去了EDA 技術(shù)的支持，是不可能順利完成出大規(guī)模集成電路設(shè)計制造的，反過來思考，現(xiàn)代集成電路技術(shù)發(fā)展需求對EDA 技術(shù)提出了更高的要求，可以預(yù)見，在不久的將來，EDA 技術(shù)定會成為電子設(shè)計中的主導力量。
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